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<article-title xml:lang="es"><![CDATA[Infraestructura y administración de cómputo paralelo y desarrollo de aplicaciones]]></article-title>
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<institution><![CDATA[,Instituto Superior Politécnico José Antonio Echeverría  ]]></institution>
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<abstract abstract-type="short" xml:lang="en"><p><![CDATA[Hybrid parallel computing infrastructure between processors and graphics cards is a work environment that has permitted the development of solutions to problems that demands elevate computing resources or problems that should process big data streams in real time. In this environment, infrastructures were configured and administrated to solve diverse problems that exploit the potentialities of a high performance cluster, built using standard hardware components. This environment allows reusing the same hardware infrastructure to solve heterogeneous problems on different applications fields. The present investigation is the result of employ an parallel focus that integrate tools, methods, techniques, standards, paradigms, algorithm design and applications development, aiming to maximize the use of multicore processors and graphics processing units by using hybrids programming models. The study ends with a platform that has been developed employing a horizontal focus that grants the modeling of new and complex computational problems, minimizing their response times.]]></p></abstract>
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</front><body><![CDATA[ <p align="right"><font face="Verdana, Arial, Helvetica, sans-serif" size="2"><B>ART&Iacute;CULO  ORIGINAL</B></font></p>     <p>&nbsp;</p>     <p><font size="4"><strong><font face="Verdana, Arial, Helvetica, sans-serif">Infraestructura y  administraci&oacute;n de c&oacute;mputo paralelo y desarrollo de aplicaciones</font></strong></font></p>     <p>&nbsp;</p>     <p><font size="3" face="Verdana, Arial, Helvetica, sans-serif"><strong>Infrastructure and  administration of parallel computing and application development</strong></font></p>     <p>&nbsp;</p>     <p>&nbsp;</p>     <P><font size="2"><strong><font face="Verdana, Arial, Helvetica, sans-serif">Omar Hernandez Duany<sup>1*</sup></font></strong><font face="Verdana, Arial, Helvetica, sans-serif"><strong>, Marlis Fulgueira Camilo</strong><font size="2"><strong><sup>1</sup></strong></font><strong>, Eulises Mu&ntilde;oz Rojas</strong><font size="2"><strong><sup>2</sup></strong></font><strong>,</strong>&nbsp;<strong>Venus Henry Fuenteseca</strong><font size="2"><font size="2"><strong><sup>2</sup></strong></font></font></font> </font>,<font size="2"><font face="Verdana, Arial, Helvetica, sans-serif"><font size="2"><font size="2"><strong>William Reyes Burunate<sup>2</sup></strong></font></font></font></font>, <strong>Ernesto Insua Suarez</strong><font size="2"><font face="Verdana, Arial, Helvetica, sans-serif"><font size="2"><font size="2"><strong><sup>2</sup></strong></font></font></font></font></p>     <p><font size="2"><font face="Verdana, Arial, Helvetica, sans-serif"><sup>1</sup></font></font><font size="2" face="Verdana, Arial, Helvetica, sans-serif"> Complejo de Investigaciones Tecnol&oacute;gicas Integradas.    <br>   </font><font size="2"><font face="Verdana, Arial, Helvetica, sans-serif"><sup>2 </sup></font></font><font size="2" face="Verdana, Arial, Helvetica, sans-serif">Instituto Superior Polit&eacute;cnico Jos&eacute; Antonio Echeverr&iacute;a</font>.    ]]></body>
<body><![CDATA[<br>     <font size="2" face="Verdana, Arial, Helvetica, sans-serif">    <br>   </font><font size="2"><strong><font face="Verdana, Arial, Helvetica, sans-serif"><sup>*</sup></font></strong></font><font size="2" face="Verdana, Arial, Helvetica, sans-serif">Autor  para correspondencia: ohernandez@udio.cujae.edu.cu &nbsp;&nbsp;&nbsp;&nbsp;&nbsp;</font> </p>     <p>&nbsp;</p> <hr>     <P><font size="2" face="Verdana, Arial, Helvetica, sans-serif"><b>RESUMEN</b> </font>     <p><font size="2" face="Verdana, Arial, Helvetica, sans-serif">La  infraestructura de computaci&oacute;n paralela h&iacute;brida entre procesadores y tarjetas  gr&aacute;ficas es un entorno que permite la ejecuci&oacute;n de soluciones paralelas que  demandan elevados requisitos de c&oacute;mputo o que realizan el procesamiento de  grandes flujos de datos en tiempo real. En este entorno se han configurado y  administrado infraestructuras paralelas para la soluci&oacute;n de dis&iacute;miles problemas  que aprovechan las potencialidades que ofrece un cl&uacute;ster de alto rendimiento,  construido empleando componentes de hardware est&aacute;ndar. Este entorno posibilita  reutilizar la misma infraestructura de hardware para resolver problemas  heterog&eacute;neos de diferentes campos de aplicaci&oacute;n. La presente investigaci&oacute;n es  el resultado de emplear un entorno paralelo que integra herramientas, m&eacute;todos,  t&eacute;cnicas, est&aacute;ndares, paradigmas, dise&ntilde;o de algoritmos y desarrollo de  aplicaciones, con el objetivo de maximizar el aprovechamiento de los  procesadores multin&uacute;cleos y las tarjetas de procesamiento gr&aacute;fico empleando modelos  de programaci&oacute;n h&iacute;bridos. El estudio finaliza con la obtenci&oacute;n de una  plataforma que ha sido desarrollada empleando un enfoque horizontal, lo que  posibilita la modelaci&oacute;n de nuevos problemas computacionalmente complejos,  logrando minimizar sus tiempos de respuestas.    <br>       <br>   <strong>Palabras clave:</strong> infraestructura,  administraci&oacute;n; cl&uacute;ster; computaci&oacute;n paralela; desarrollo de aplicaciones.</font></p> <hr>     <p><font size="2" face="Verdana, Arial, Helvetica, sans-serif"><b><span lang=EN-GB>ABSTRACT</span></b> </font></p>     <p><font size="2" face="Verdana, Arial, Helvetica, sans-serif">Hybrid parallel computing  infrastructure between processors and graphics cards is a work environment that  has permitted the development of&nbsp;solutions to problems that demands  elevate computing resources or problems that should process big data streams in  real time. In this environment, infrastructures were configured and  administrated to solve diverse problems that exploit the potentialities of a  high performance cluster, built using standard hardware components. This  environment allows reusing the same hardware infrastructure to solve  heterogeneous problems on different applications fields. The present  investigation is the result of employ an parallel focus that integrate tools,  methods, techniques, standards, paradigms, algorithm design and applications  development, aiming to maximize the use of multicore processors and graphics  processing units by using hybrids programming models. The study ends with a  platform that has been developed employing a horizontal focus that grants the  modeling of new and complex computational problems, minimizing their response  times.    <br>       ]]></body>
<body><![CDATA[<br> <strong>Keywords: </strong>infrastructure;  administration; cluster; parallel computing; application development. </font> </p> <hr>     <p><font size="3" face="Verdana, Arial, Helvetica, sans-serif"><b>INTRODUCCI&Oacute;N</b></font></p>     <p><font size="2" face="Verdana, Arial, Helvetica, sans-serif">En la actualidad es  posible identificar un n&uacute;mero creciente de problemas de elevada complejidad  computacional en diferentes campos de las ciencias, cuyas implementaciones  requieren ser estudiadas para lograr la reducci&oacute;n de sus tiempos de ejecuci&oacute;n.  La computaci&oacute;n paralela y distribuida es, en muchos casos, un m&eacute;todo eficaz  para la soluci&oacute;n de este tipo de problemas.    <br>       <br>   La infraestructura de  computaci&oacute;n paralela h&iacute;brida entre procesadores y tarjetas gr&aacute;ficas es un  entorno de desarrollo que permite el dise&ntilde;o, implementaci&oacute;n y ejecuci&oacute;n de  soluciones paralelas. Est&aacute; conformada por varios componentes tecnol&oacute;gicos que  intervienen en la reducci&oacute;n del tiempo de ejecuci&oacute;n de las aplicaciones. Las  t&eacute;cnicas empleadas en la plataforma posibilitan maximizar el aprovechamiento de  las capacidades de c&oacute;mputo que ofrecen los procesadores multin&uacute;cleos y las  tarjetas de procesamiento gr&aacute;fico.    <br>       <br>   La presente  investigaci&oacute;n contiene un resumen de los resultados obtenidos a partir del estudio  de un conjunto de aspectos tecnol&oacute;gicos como son: los componentes de hardware  actuales, las herramientas de administraci&oacute;n para la configuraci&oacute;n de los  entornos paralelos bajo Linux y Windows, m&eacute;todos, t&eacute;cnicas, est&aacute;ndares,  paradigmas; an&aacute;lisis y dise&ntilde;o de algoritmos e implementaci&oacute;n de aplicaciones  paralelas en entornos h&iacute;bridos.    <br>       <br> Como resultado de la  investigaci&oacute;n se ha logrado comprobar la efectividad y reusabilidad de la  tecnolog&iacute;a en dis&iacute;miles campos de investigaci&oacute;n entre los que pueden  mencionarse: la criptograf&iacute;a, el procesamiento digital de se&ntilde;ales y la  recuperaci&oacute;n de informaci&oacute;n a partir de grandes conjuntos de datos. Se ha  logrado la modelaci&oacute;n paralela de m&eacute;todos y algoritmos que fueron originalmente  concebidos o implementados de forma secuencial. En la plataforma se han  configurado infraestructuras que permiten acelerar la obtenci&oacute;n de resultados  de otras l&iacute;neas de investigaci&oacute;n como son: el Cl&uacute;ster de MATLAB y el <em>rendering</em> distribuido.</font></p>     <p><font face="Verdana, Arial, Helvetica, sans-serif"><strong><font size="3">MATERIALES Y M&Eacute;TODOS</font></strong></font></p>     ]]></body>
<body><![CDATA[<p><font size="2"><strong><font face="Verdana, Arial, Helvetica, sans-serif">Las arquitecturas de hardware y la computaci&oacute;n  paralela</font></strong><font face="Verdana, Arial, Helvetica, sans-serif">    <br>   La industria de hardware ha colocado en  el mercado una gran diversidad de configuraciones de hardware de gama extrema,  alta, media y baja, que poseen procesadores con m&uacute;ltiples n&uacute;cleos (CPU, por sus  siglas en ingl&eacute;s) y tarjetas de procesamiento gr&aacute;fico (GPU, por sus siglas en  ingl&eacute;s), con elevados rendimientos (<a href="#_ENREF_2" title="AMD, 2013 #29">AMD, 2013</a>; <a href="#_ENREF_7" title="Intel, 2013 #30">Intel, 2013</a>).      <br>       <br>   La mayor&iacute;a de los  desarrolladores contin&uacute;an dise&ntilde;ando soluciones secuenciales por lo que no  aprovechan en toda su dimensi&oacute;n las capacidades del hardware de las  configuraciones disponibles en la actualidad. Puede decirse que el  aprovechamiento promedio de los CPU es aproximadamente el 20% de sus  capacidades y las tarjetas GPU est&aacute;n por debajo del 10%. Esto puede constituir  una oportunidad para el replanteamiento del dise&ntilde;o de las aplicaciones que  aprovechen las capacidades en la soluci&oacute;n de problemas que demandan requisitos  de c&oacute;mputo superiores.    <br>       <br>   En el contexto de la  plataforma se ha construido un Cl&uacute;ster HPC (<em>High  Performance</em> <em>Cluster</em>, por sus  siglas en ingl&eacute;s) empleando componentes de hardware comerciales, conocidos en  la literatura especializada como componentes COTS (<em>Commodity Off-The-Shelf</em>, por sus siglas  en ingl&eacute;s). Esto ha sido realizado bajo la premisa de incorporar al c&oacute;mputo  masivo las tarjetas GPU, para reutilizar sus potencialidades en funci&oacute;n de la soluci&oacute;n  de problemas de prop&oacute;sito general, lo que se conoce como GPGPU (General-Purpose  computing on Graphics Processor Unit, por sus siglas en ingl&eacute;s) (<a href="#_ENREF_4" title="Buyya, 1999 #55">Buyya, 1999</a>).     <br>       <br>   <strong>Construcci&oacute;n del  cl&uacute;ster HPC </strong>    <br>       <br>   El proceso de  construcci&oacute;n del Cl&uacute;ster HPC fue realizado siguiendo el modelo propuesto por  Donald Becker y Tomas Sterling, en la NASA (<em>National  Aeronautics and Space Administration</em>, por el significado de sus siglas en  ingl&eacute;s) en el a&ntilde;o 1994, con la peculiaridad de que incorpora nuevos componentes  de hardware de mayor rendimiento como se puede apreciar en la <a href="#f01">figura  1</a>.    ]]></body>
<body><![CDATA[<br>   Posee un servidor o  nodo master y ocho nodos de c&oacute;mputo, conectados a trav&eacute;s de un <em>switch</em> Gigabit Ethernet (<em>GbE</em>, por el significado de sus siglas en  ingl&eacute;s). Los nodos de c&oacute;mputo poseen las caracter&iacute;sticas siguientes: CPU: Intel  Core i7-920@2.66 GHz (4 n&uacute;cleos), 6 Gb de memoria RAM DDR3@1333 MHz, 2 tarjetas  GPU del tipo nVidia GTX 260 con 896 Mb de memoria de video dedicada, las cuales  pueden ser soportadas en los gabinetes ATX (<em>Advanced</em> <em>Technology eXtended</em>, por sus siglas  en ingl&eacute;s), a los cuales se incorporaron fuentes de alimentaci&oacute;n fabricadas por  la compa&ntilde;&iacute;a <em>HuntKey</em> con 600W de  potencia aparente. La <em>motherboard</em> empleada fue fabricada por la compa&ntilde;&iacute;a XFX y re manufacturada por <em>Haier</em>, la cual posee un z&oacute;calo LGA 1366,  6 bancos de memoria RAM y 3 slots PCI-Express (Rosch, 1999).    <br>       <br> El servidor del Cl&uacute;ster  posee un procesador Intel Core i7 920@2.66 GHz, con 4 n&uacute;cleos de procesamiento,  24 Gb de memoria RAM DDR3@1333 MHz y una tarjeta GPU nVidia GTX 260, con 896 Mb  de memoria de video dedicada. El resto de los componentes son los mismos que se  encuentran en los nodos. Se obtiene un aumento del rendimiento en un 85% por  nodo al incorporar las tarjetas gr&aacute;ficas, sin producirse una elevaci&oacute;n notable  de la temperatura de los componentes de hardware y logr&aacute;ndose extraer  adecuadamente el calor disipado.</font></font></p>     <p align="center"><img src="/img/revistas/rcci/v9n5/f0102515.jpg" width="345" height="284"><a name="f01"></a></p>     <p><font size="2" face="Verdana, Arial, Helvetica, sans-serif">Previo a la  construcci&oacute;n del cl&uacute;ster se evaluaron las tarjetas GPU de la serie GeForce, los  modelos 9800 GT, GT 240 y GTX 260,  validando sus potencialidades a trav&eacute;s de los test de <em>benchmark</em> y las aplicaciones desarrolladas por el proyecto. El  Cl&uacute;ster construido posee un rendimiento pico te&oacute;rico de 9 <em>TFlops</em> (9x1024 <em>GFlops</em>),  lo que posibilita abordar la soluci&oacute;n de problemas de elevada complejidad  computacional.    <br>       <br>   Para la construcci&oacute;n  del Cl&uacute;ster se han reutilizado computadoras de escritorio previamente  adquiridas trabajando de forma integrada, por lo que no ha sido necesario  disponer de nuevos recursos financieros. El dise&ntilde;o empleado es escalable, desde  el punto de vista de hardware, en cuyo caso, se requiere un an&aacute;lisis de los  requisitos de climatizaci&oacute;n y de los componentes mec&aacute;nicos para el montaje de  los nodos del Cl&uacute;ster. El dise&ntilde;o por capas de la plataforma permite la integraci&oacute;n  de forma arm&oacute;nica y gradual de los avances que se han ido produciendo en  materia de administraci&oacute;n de entornos paralelos, as&iacute; como las nuevas  herramientas de desarrollo. Estos poseen una evoluci&oacute;n acelerada en  correspondencia con el ritmo que experimenta la industria del hardware y que  hacen posible la validaci&oacute;n de nuevos dise&ntilde;o de algoritmos paralelos o la  modelaci&oacute;n algoritmos cl&aacute;sicos en funci&oacute;n de las nuevas arquitecturas de  hardware.    <br>       <br>   <strong>Descripci&oacute;n de  las herramientas de administraci&oacute;n&nbsp; </strong>    <br>       ]]></body>
<body><![CDATA[<br>   En el nodo servidor o  m&aacute;ster del cl&uacute;ster, fue instalada la plataforma de virtualizaci&oacute;n <em>ESXi</em> 5.0, que soporta las m&aacute;quinas  virtuales que contienen diferentes soluciones paralelas, con el objetivo de  emplear las potencialidades del cl&uacute;ster en diferentes campos de aplicaci&oacute;n, y  crear un pol&iacute;gono de experimentaci&oacute;n que preserve la configuraci&oacute;n de las  restantes soluciones, como se muestra en la Figura  2. Las m&aacute;quinas virtuales son  ejecutadas una a la vez, con el fin de utilizar de forma eficaz la capacidad de  c&oacute;mputo instalada.</font></p>     <p align="center"><img src="/img/revistas/rcci/v9n5/f0202515.jpg" width="436" height="247"><a name="f02"></a></p>     <p><font size="2" face="Verdana, Arial, Helvetica, sans-serif">La definici&oacute;n de la  plataforma como un pol&iacute;gono experimental, ha extendido el alcance de la  infraestructura, lo que ha abierto las posibilidades de validaci&oacute;n de varios  entornos de desarrollo que pueden ser multiplataforma, empleando la misma  arquitectura de hardware. La accesibilidad a la plataforma puede realizarse  desde nodos clientes remotos que pueden emplear indistintamente las soluciones  configuradas a partir de haber sido acreditados.    <br>       <br>   A continuaci&oacute;n se presentan los cinco  entornos de desarrollo paralelos configurados hasta el momento ( <a href="/img/revistas/rcci/v9n5/t0102515.jpg" target="_blank">tabla 1</a>  ).</font></p>     <p><font size="2"><strong><font face="Verdana, Arial, Helvetica, sans-serif">Caos NSA</font></strong><font face="Verdana, Arial, Helvetica, sans-serif">    <br>       <br>   Es una distribuci&oacute;n  Linux concebida para facilitar el proceso de configuraci&oacute;n y administraci&oacute;n de  un cl&uacute;ster de alto rendimiento. Contiene la herramienta de administraci&oacute;n <em>Perceus</em> 1.5.3<em>, </em>que permite la administraci&oacute;n desde l&iacute;nea de comandos y la  aplicaci&oacute;n <em>Sidekick</em> que permite  configurar el cl&uacute;ster desde men&uacute; en modo texto. En este entorno se pueden  ejecutar soluciones paralelas desarrolladas en lenguaje C/C++ para Linux, y las  bibliotecas que permiten el desarrollo de aplicaciones paralelas en memoria  compartida o distribuida, como son: OpenMP y MPI (<a href="#_ENREF_12" title="Omar Antonio Hernandez Duany, 2010 #1">Omar Antonio Hernandez Duany, 2010</a>).     <br>       <br>   <strong>Cl&uacute;ster MATLAB</strong>    ]]></body>
<body><![CDATA[<br>       <br>   El entorno MATLAB  provee sus propias herramientas para la configuraci&oacute;n y ejecuci&oacute;n de tareas en  un ambiente distribuido. Los componentes que facilitan dicho proceso se conocen  como Bibliotecas espec&iacute;ficas de Computaci&oacute;n Paralela (<em>Parallel Computing Toolbox</em>, por su traducci&oacute;n al ingl&eacute;s)y Servidor de Computaci&oacute;n Distribuida  de Matlab (<em>Matlab Distributed Computing  Server</em>, por su traducci&oacute;n al ingl&eacute;s), las cuales se presentan en su versi&oacute;n  6.0. La primera de ellas permite la implementaci&oacute;n paralela de aplicaciones,  mientras que la segunda se enfoca en la distribuci&oacute;n de tareas hacia diversos  recursos computacionales del cl&uacute;ster, lo que permite el aprovechamiento de las  potencialidades de las arquitecturas multin&uacute;cleo Estas herramientas pueden  configurarse mediante l&iacute;neas de comandos o a trav&eacute;s de la interfaz gr&aacute;fica de  usuario <em>Admin Center</em> (<a href="#_ENREF_9" title="MathWorks, 11 de septiembre 2013 #13">MathWorks, 2013</a>; <a href="#_ENREF_10" title="MathWorks, 16 de marzo 2012 #14">MathWorks, 2012</a>). En este <em>cl&uacute;ster</em> pueden ejecutarse soluciones  desarrolladas en MATLAB, enfoc&aacute;ndose esta investigaci&oacute;n en el campo del  procesamiento digital de se&ntilde;ales.     <br>       <br>   <strong>Rendering distribuido</strong>    <br>       <br>   La granja de <em>rendering</em> permite acelerar el proceso de  representaci&oacute;n de im&aacute;genes y videos, lo que resulta importante para el  desarrollo de soluciones multimedia, realidad virtual, arquitectura, entre  otras. Se ha mejorado notablemente el rendimiento del <em>renderizado </em>al configurar en este entorno las tarjetas GPU del <em>cl&uacute;ster</em>.     <br>       <br>   <strong>C&oacute;mputo distribuido basado en Java</strong>    <br>       <br>   El <em>framework</em> JPPF + JCUDA permite la ejecuci&oacute;n de tareas desarrolladas  en Java para un ambiente distribuido. Esta soluci&oacute;n permite a los  desarrolladores aprovechar de forma m&aacute;s efectiva la arquitectura de hardware,  sin requerir la migraci&oacute;n de sus aplicaciones a los lenguajes en los que  generalmente se desarrollan aplicaciones paralelas, como C/C++. La curva de  aprendizaje es baja y los programadores en Java pueden desarrollar soluciones paralelas  en su ambiente nativo.    ]]></body>
<body><![CDATA[<br>       <br>   <strong>Rocks Cluster</strong>    <br>       <br>   Sistema  operativo altamente difundido. Dicho sistema es f&aacute;cil de instalar, integra  herramientas de configuraci&oacute;n para facilitarle en trabajo al usuario, incorpora  un conjunto de software para instalar a petici&oacute;n del usuario (llamados &ldquo;<em>rolls</em>&rdquo;), entre otros. Es basado en <em>CentOS</em> y <em>RedHat Enterprise</em>. Dicho sistema posee una comunidad activa hoy en  d&iacute;a, la cual libera nuevas versiones del mismo y brinda soporte t&eacute;cnico a los  usuarios. El sistema se acoge a la ley del <em>copyleft</em>,  por lo que es un software libre. </font></font></p>     <p align="left">&nbsp;</p>     <p><font size="2"><strong><font size="3" face="Verdana, Arial, Helvetica, sans-serif">RESULTADOS Y DISCUCI&Oacute;N     <br>   </font></strong><font face="Verdana, Arial, Helvetica, sans-serif">    <br>   <strong>Soluciones  obtenidas en el contexto de la plataforma</strong>    <br>       <br>   En esta investigaci&oacute;n  el enfoque paralelo ha estado presente desde la selecci&oacute;n de los componentes de  hardware, hasta el desarrollo de las aplicaciones, por lo que todos los problemas  son el resultado de la integraci&oacute;n de herramientas, m&eacute;todos, t&eacute;cnicas,  est&aacute;ndares, paradigmas, dise&ntilde;o de algoritmos e implementaci&oacute;n de aplicaciones.    ]]></body>
<body><![CDATA[<br>       <br>   A continuaci&oacute;n se  presentan algunos de los resultados que han sido empleados para validar la  tecnolog&iacute;a.    <br>       <br>   <strong>B&uacute;squeda paralela empleando procesadores multihilos</strong>    <br>       <br>   La implementaci&oacute;n  paralela del algoritmo de b&uacute;squeda basado en un &aacute;rbol binario rojo y negro ha  sido validada empleando el paradigma de programaci&oacute;n de memoria compartida <em>OpenMP</em> (<a href="#_ENREF_6" title="Foster, 1995 #30">Foster, 1995</a>).    <br>        <br> La <a href="#f03">figura 3</a> muestra  los resultados de las b&uacute;squeda de 100 000 informaciones diferentes en un  conjunto de un mill&oacute;n de posibilidades en una base de datos, reduci&eacute;ndose en 4  veces el tiempo de b&uacute;squeda respecto a la versi&oacute;n secuencial utilizando un solo  nodo de c&oacute;mputo sin emplear GPU.La prueba se ejecut&oacute; sobre un  CPU Intel Core i7-920.</font></font></p>     <p align="center"><img src="/img/revistas/rcci/v9n5/f0302515.jpg" width="391" height="203"><a name="f03"></a></p>     <p><font size="2" face="Verdana, Arial, Helvetica, sans-serif">El experimento realizado resulta equivalente a  un sistema que requiere responder a 100 000 consultas concurrentes a partir de  la b&uacute;squeda en una base de datos, lo que puede resultar t&iacute;pico en una soluci&oacute;n  empresarial.    ]]></body>
<body><![CDATA[<br>   Se logr&oacute; una reducci&oacute;n  del tiempo respecto a la versi&oacute;n secuencial en una proporci&oacute;n de 4 veces por  nodo, empleando CPU, lo que puede reducirse en una proporci&oacute;n que relativa a la  cantidad de nodos que se empleen. En el caso de emplear 8 nodos es posible  realizar b&uacute;squedas 32 veces m&aacute;s r&aacute;pido, lo que permitir&iacute;a responder a encuestas  sucesivas de la existencia de un identificador en un conjunto millonario de  datos estructurados en tiempo real. Se desarrolla el equivalente para GPU lo  que aumentar&iacute;a el rendimiento.    <br>       <br>   <strong>Implementaci&oacute;n de algoritmo criptogr&aacute;fico GOST en  entornos h&iacute;bridos</strong>    <br>       <br>   El algoritmo GOST es el  est&aacute;ndar criptogr&aacute;fico ruso y ha sido empleado en la protecci&oacute;n de canales de  comunicaci&oacute;n. En este caso fue utilizado para comprobar a partir de  experimentos la posibilidad de acelerar los procesos de cifrado/descifrado, sin  realizar modificaciones al algoritmo est&aacute;ndar publicado (<a href="#_ENREF_13" title="Oreku, 2007 #37">Oreku, 2007</a>; <a href="#_ENREF_5" title="Courtois, 2011 #36">Courtois, 2011</a>; <a href="#_ENREF_14" title="Rabie A. Mahmoud, 2013 #50">Rabie A. Mahmoud, 2013</a>).     <br>       <br>   Se ha hecho &eacute;nfasis en  su implementaci&oacute;n en CPU y GPU, evaluando los rendimientos alcanzados por cada  una de las implementaciones realizadas empleando OpenMP y <em>Compute Unified Device Architecture</em> (CUDA, por sus siglas en  ingl&eacute;s) respectivamente (<a href="#_ENREF_15" title="Sanders, 2011 #43">Sanders and  Kandrot, 2011</a>).    <br>       <br>   Las dimensiones de los  ficheros empleados en los experimentos fueron: 1.26MB, 18.1MB, 224MB y 730MB.    <br>       ]]></body>
<body><![CDATA[<br>   En las <a href="#f04">figura  4</a> y <a href="#f05">figura  5</a> se presentan el tiempo empleado en  la operaci&oacute;n de cifrado para cada uno de los archivos. Se puede apreciar que el  tiempo de ejecuci&oacute;n al utilizar GPU es notablemente inferior al obtenido  empleando el CPU. Con el incremento del tama&ntilde;o del fichero a cifrar, se produce  un aumento de la diferencia en el rendimiento entre GPU y CPU.</font></p>     <p align="center"><img src="/img/revistas/rcci/v9n5/f0402515.jpg" width="546" height="193"><a name="f04"></a></p>     <p align="center"><img src="/img/revistas/rcci/v9n5/f0502515.jpg" width="570" height="216"><a name="f05"></a></p>     <p><font size="2" face="Verdana, Arial, Helvetica, sans-serif">En las <a href="#f04">figura 4</a>  y <a href="#f05">figura 5</a>  se muestran  los resultados del experimento al cifrar el fichero de mayor tama&ntilde;o (730 MB),  incluyendo en este caso la comparaci&oacute;n con la implementaci&oacute;n secuencial. Se  puede observar que la implementaci&oacute;n realizada empleando CUDA disminuye  considerablemente el tiempo de cifrado con respecto a las implementaciones  secuenciales y con OpenMP, lo que se traduce en la posibilidad de cifrar un  mayor volumen de informaci&oacute;n en menor tiempo.</font></p>     <p><font size="2" face="Verdana, Arial, Helvetica, sans-serif"><strong>Implementaci&oacute;n del algoritmo de miner&iacute;a de datos Expectaci&oacute;n-Maximizaci&oacute;n  en entornos h&iacute;bridos</strong>    <br>       <br>   El algoritmo  Expectaci&oacute;n-Maximizaci&oacute;n (EM, por sus siglas) es un algoritmo de Miner&iacute;a de  datos, que se encuentra dentro de la tarea de agrupamiento. Existen dos  aplicaciones principales del algoritmo EM: la primera es cuando los datos  tienen valores faltantes derivados del proceso de observaci&oacute;n y la segunda est&aacute;  dada por la posibilidad de la estimaci&oacute;n de patrones(<a href="#_ENREF_1" title="A. P. Dempster, 1977 #10">A. P. Dempster,  1977</a>; <a href="#_ENREF_11" title="NVIDIA, 2007 #34">NVIDIA, 2007</a>; <a href="#_ENREF_8" title="knowledgrES.com, 2013 #57">knowledgrES.com, 2013</a>).     <br>       <br>   Se ha hecho &eacute;nfasis en  su implementaci&oacute;n en CPU y GPU, evaluando los rendimientos alcanzados por cada  una de las implementaciones realizadas empleando OpenMP y OpenCL. La dimensi&oacute;n  del fichero empleado en los experimentos fue de 83 MB.    <br>   En las <a href="#f06">figura  6</a> y <a href="#f07">figura 7</a> se presenta el tiempo empleado  para realizar el agrupamiento. Se puede apreciar que el tiempo de ejecuci&oacute;n al  utilizar GPU es notablemente inferior al obtenido empleando el CPU. </font></p>     ]]></body>
<body><![CDATA[<p align="center"><img src="/img/revistas/rcci/v9n5/f0602515.jpg" width="436" height="273"><a name="f06"></a></p>     <p align="center"><img src="/img/revistas/rcci/v9n5/f0702515.jpg" width="422" height="285"><a name="f07"></a></p>     <p align="center"><img src="/img/revistas/rcci/v9n5/f0802515.jpg" width="370" height="219"><a name="f08"></a></p>     <p><font size="2" face="Verdana, Arial, Helvetica, sans-serif">En la <a href="#f08">figura  8</a> se muestran los resultados del  experimento al agrupar, incluyendo en este caso la comparaci&oacute;n con la  implementaci&oacute;n secuencial. Se puede observar que la implementaci&oacute;n realizada  empleando OpenCL sobre tarjetas gr&aacute;ficas disminuye considerablemente el tiempo  de agrupamiento con respecto a las implementaciones secuenciales y con OpenMP,  lo que significa que se puede agrupar un mayor volumen de informaci&oacute;n en menos  tiempo.    <br>       <br>     <strong>Restauraci&oacute;n de la visibilidad de im&aacute;genes  utilizando MATLAB</strong>     <br>         <br>   El algoritmo est&aacute; enfocado en la restauraci&oacute;n de visibilidad de una imagen afectada por  elementos ambientales como humo o niebla. Dichos elementos ensombrecen colores  y reducen el contraste de los objetos contenidos en una imagen. El algoritmo  puede ser utilizado en im&aacute;genes en escala de grises y en colores; donde se  destaca su velocidad de ejecuci&oacute;n en comparaci&oacute;n con otros algoritmos  secuenciales (<a href="#_ENREF_3" title="BARCHIESI, 2008 #15">BARCHIESI, 2008</a>; <a href="#_ENREF_16" title="Zald&iacute;var,  2011 #2">Zald&iacute;var, 2011</a>).     <br>       <br>   Las pruebas  secuenciales y paralelas se utilizan par&aacute;metros id&eacute;nticos, donde se procesaron  im&aacute;genes con una resoluci&oacute;n de 2000x1333. Las caracter&iacute;sticas de hardware  empleada para ambas implementaciones se desarrollaron en procesadores CPU Intel  Core i7-920. En el caso secuencial se utiliza un CPU, mientras que paralelo se  utilizan dos de estos CPU.    La <a href="#f09">figura  9</a>.  <strong>Imagen  original a la izquierda, imagen restaurada a la derecha.</strong> se muestra la imagen original con  niveles de niebla perceptibles y la imagen obtenida, despu&eacute;s del procesamiento  secuencial.</font></p>     ]]></body>
<body><![CDATA[<p align="center"><img src="/img/revistas/rcci/v9n5/f0902515.jpg" width="474" height="240"><a name="f09"></a></p>     <p><font size="2" face="Verdana, Arial, Helvetica, sans-serif">El tiempo paralelo es  comparado con el tiempo secuencial donde se puede apreciar en la <a href="#f10">figura 10</a>.<strong> Comparaci&oacute;n del tiempo de  ejecuci&oacute;n secuencial y paralelo.</strong> , que el procesamiento paralelo  disminuye 6 veces el tiempo de ejecuci&oacute;n secuencial, lo que representa una  mejora del 85%.</font></p>     <p align="center"><img src="/img/revistas/rcci/v9n5/f1002515.jpg" width="472" height="260"><a name="f10"></a></p>     <p align="left">&nbsp;</p>     <p><font face="Verdana, Arial, Helvetica, sans-serif" size="3"><B>CONCLUSIONES    <br>       <br>   </B></font><font size="2" face="Verdana, Arial, Helvetica, sans-serif">Los resultados  obtenidos han permitido validar la plataforma de computaci&oacute;n paralela h&iacute;brida  construida, aprovechando indistintamente las potencialidades de los  procesadores multin&uacute;cleos y las tarjetas de procesamiento gr&aacute;fico.    <br>   Con la construcci&oacute;n de  un cl&uacute;ster h&iacute;brido se logra sustituir la adquisici&oacute;n de una supercomputadora,  la cual posee costos en el orden de los millones de d&oacute;lares, obteni&eacute;ndose una  mejor relaci&oacute;n costo-rendimiento. En este caso no fue necesaria la erogaci&oacute;n de  recursos financieros adicionales para su construcci&oacute;n. El proceso de  construcci&oacute;n y administraci&oacute;n del cl&uacute;ster HPC y su entorno de desarrollo, puede  ser recreado en otros escenarios a partir de emplear computadoras personales  con las caracter&iacute;sticas descritas o superiores, sin requerirse nuevos recursos  financieros. Es importante dejar sentado que las tarjetas gr&aacute;ficas m&aacute;s id&oacute;neas  para la construcci&oacute;n del cl&uacute;ster a partir del an&aacute;lisis de los resultados  te&oacute;ricos son de la serie nVidia Tesla, que han sido concebidas especialmente  para el procesamiento de alto rendimiento.    <br>       <br>   La plataforma de  computaci&oacute;n paralela h&iacute;brida es un entorno din&aacute;mico que requiere ser renovado  sistem&aacute;ticamente en la medida en que se disponga de nuevos componentes de  hardware, con lo que debe lograrse la elevaci&oacute;n sistem&aacute;tica de su rendimiento  pico te&oacute;rico en correspondencia con el ritmo acelerado que se observa en la  industria de hardware. Esta tiene un car&aacute;cter horizontal, creando las bases  para la soluci&oacute;n de problemas de diversos campos de aplicaci&oacute;n, hasta el  momento se han obtenido mejoras notables de los rendimientos de las aplicaciones  desarrolladas, lo que ha redundado en la reducci&oacute;n de sus tiempos de ejecuci&oacute;n.  Se puede afirmar que es un instrumento indispensable para el desarrollo de  diversas &aacute;reas de investigaci&oacute;n.    ]]></body>
<body><![CDATA[<br>       <br>   Se han configurado  cinco entornos de software resultantes del an&aacute;lisis, dise&ntilde;o, e implementaci&oacute;n  de algoritmos y aplicaciones paralelas, en cada uno de los casos se ha logrado  una reducci&oacute;n de hasta un 75% de los tiempos de ejecuci&oacute;n, a partir de emplear  el enfoque de maximizar el uso de procesadores y tarjetas gr&aacute;ficas. Los  entornos de software configurados han sido introducidos en la pr&aacute;ctica a partir  de su reutilizaci&oacute;n por otros sistemas o tomados como referencia para el  desarrollo de aplicaciones con funcionalidades similares, con el consiguiente  aumento de su rendimiento.    <br>       <br>   Los experimentos  realizados en ambientes de memoria compartida y distribuida dieron como  resultado la configuraci&oacute;n de soluciones h&iacute;bridas, las cuales en todos los  casos reducen los tiempos de ejecuci&oacute;n de las aplicaciones.     <br> En cualquier caso la premisa ha sido la  creaci&oacute;n de un Laboratorio de Computaci&oacute;n Paralela y distribuida que constituya  un pol&iacute;gono experimental para el desarrollo de disimiles investigaciones y que  a su vez contribuya a la formaci&oacute;n de especialistas en este campo de las  ciencias.</font></p>     <p>&nbsp;</p>     <p><font size="3" face="Verdana, Arial, Helvetica, sans-serif"><strong>AGRADECIMIENTOS</strong></font></p>     <p>  <font size="2" face="Verdana, Arial, Helvetica, sans-serif">Los autores agradecen al Complejo de Investigaciones Tecnol&oacute;gicas  Integradas (CITI) y al Instituto Superior Polit&eacute;cnico Jos&eacute; Antonio Echeverr&iacute;a  (CUJAE). A jefes, directivos, especialistas y personal de apoyo de las  instituciones mencionadas, que han colaborado de una forma u otra durante el  proceso de obtenci&oacute;n de estos resultados. </font></p>     <p>&nbsp;</p>     <p><font face="Verdana, Arial, Helvetica, sans-serif" size="3"><B>REFERENCIAS    BIBLIOGR&Aacute;FICAS</B></font></p>     ]]></body>
<body><![CDATA[<p><font size="2" face="Verdana, Arial, Helvetica, sans-serif">ALVEIRO, M. C. Evaluaci&oacute;n  del desempe&ntilde;o como herramienta para el an&aacute;lisis del capital humano, [En l&iacute;nea].  2009. [Disponible en: http://www.scielo.org.ar/pdf/vf/v11n1/v11n1a05.pdf    <br>         <!-- ref --><br> CORTEZ, A. V.  and V. P. VIRGINIA Sistemas Razonamiento basado en Reglas para determinar  recomendaci&oacute;n de cirug&iacute;a refractiva Revista Alghoritmic, 2010, Vol1, no1, pp  28-36, ISSN 2220-3982.    <br>     <br> DUAN, A.:  &ldquo;Definici&oacute;n de sistema de Informaci&oacute;n.&rdquo;. [En l&iacute;nea], Consultado el 26 de  diciembre 2012, Disponible en: http://www.econlink.com.ar/sistemas-informacion/, 2011.    <br>     <br> FERN&Aacute;NDEZ, B. G.  La Toma de  Decisiones Multicriterio eficaces en el &aacute;mbito de la peque&ntilde;a y mediana empresa:  El establecimiento de los objetivos y la determinaci&oacute;n de los criterios. Fac  CC. Econ&oacute;micas y Empresariales. Universidad San Pablo, [En l&iacute;nea]. 2000. [Consultado  el 8 de Marzo 2013]. Disponible en:  http://eco-mat.ccee.uma.es/asepuma/laspalmas2001/laspalmas/invp01.PDF     <br>     <!-- ref --><br> GONZ&Aacute;LEZ, J.  Propuesta de algoritmo de clasificaci&oacute;n gen&eacute;tico. 2013. RCI, Vol.4, No2. ISSN:  2223-1781    <br>     ]]></body>
<body><![CDATA[<br> GUTI&Eacute;RREZ, J. M.  Sistema basado en reglas, [En l&iacute;nea]. 2010. [Consultado el: 20 mayo 2013].  Disponible en: http://personales.unican.es/gutierjm/cursos/expertos/Reglas.pdf     <br>     <br> HERN&Aacute;NDEZ, I.;  T. MAR&Iacute;A, et al. Inventario de conocimientos del sistema de gesti&oacute;n integrada  de capital humano referenciado en las normas cubanas 3000: 2007 / inventory of  knowledges of the human capital integrated management system referenced in the  cuban regulations 3000: 2007 Ingenier&iacute;a Industrial, 2010, Vol. XXXII No. 2  mayo-agosto. p. 132-140. ISSN 1815-5936.    <br>     <!-- ref --><br> HENAO, M. and A.  BERTHA Fusi&oacute;n de dos tecnolog&iacute;as: Ingenier&iacute;a del conocimiento (IC) + Multimedia  (MM) Ingenier&iacute;a Industrial, 1994, Revista EAFIT. Vol. 30, n&uacute;m. 96.    <br>     <br> LEMOS GARC&Iacute;A, J.;  CASTELLANOS GUEVARA, Integrated Management of Health Services in the Areas of  Magdalene College Union V.Scientia et Technica A&ntilde;o XVII&rdquo;, No 50, Abril de A&ntilde;o  2012. Universidad Tecnol&oacute;gica de Pereira. ISSN 0122-1701    <br>     <!-- ref --><br> MAR, O. Modelo  multicriterio multiexperto utilizando Mapa Cognitivo Difuso para la evaluaci&oacute;n  de competencias. Ciencias de la Informaci&oacute;n, 2015. Vol.46, No2. ISSN: 1606-4925    <br>     ]]></body>
<body><![CDATA[<!-- ref --><br> MERIG&Oacute;, J. New extensions  to the OWA operators and its application in decision making, PhD Thesis, 2008,  Department of Business Administration, University of Barcelona.    <br>     <!-- ref --><br> MTSS. Sistema de  Pago Adicional para los trabajadores de la Universidad de Ciencias Inform&aacute;ticas  MTSS, 2007.    <br>     <br> PALMERO, M.; P.  MILDA, et al. Procedimiento para evaluar el impacto de la capacitaci&oacute;n en la  empresa constructora integral de Mayabeque Ingenier&iacute;a Industrial, 2012, Vol.  XXXIII. No. 3 septiembre-diciembre p. 215-225. ISSN 1815-5936.    <br>     <br> RODR&Iacute;GUEZ, J. F.  O. Evaluaci&oacute;n del desempe&ntilde;o del docente de la unidad educativa prof. fernando  ram&iacute;rez REVISTA ICONO, 2010, No14, Vol. 2, pp. 58-70. ISSN 1697-8293.    <br>     <!-- ref --><br> ROMERO, B. P. and A. J.  CH. Decisiones multicriterio: Fundamentos Te&oacute;ricos y Utilizaci&oacute;n pr&aacute;ctica  Colecci&oacute;n de Econom&iacute;a. Universidad de Alcal&aacute;, 1997, Espa&ntilde;a. 66-90 p.    <br>     ]]></body>
<body><![CDATA[<!-- ref --><br> SALAS, R. S.  Propuesta de estrategia para la evaluaci&oacute;n del desempe&ntilde;o laboral de los m&eacute;dicos  en Cuba Educ Med Super, 2010, v.24 n.3 jul.-sep. ISSN 1561-2902.    <br>     <!-- ref --><br> SANTOS, A. C.  Evaluando desempe&ntilde;os: alineamiento estrat&eacute;gico y productividad. FORUM  Empresarial, 2012, Vol. 17, N&uacute;m. 1. pp. 1-30. ISSN 1541-8561ONN.    <!-- ref --> Sistema de  gesti&oacute;n integrada de capital humano - requisitos 2007, NORMA CUBANA, (NC 3001).    <br>     <br> YAGER, R. On ordered  weighted averaging aggregation operators in multicriteria decisionmaking,  Systems, Man and Cybernetics, IEEE Transactions on, 1988, vol. 18, pp. 183-190. </font></p>     <p>&nbsp;</p>     <p>&nbsp;</p>     <p><font size="2" face="Verdana, Arial, Helvetica, sans-serif">Recibido: 05/01/2015        <br> Aceptado: 16/02/2015</font>    </p>     ]]></body>
<body><![CDATA[ ]]></body><back>
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<source><![CDATA[Sistemas Razonamiento basado en Reglas para determinar recomendación de cirugía refractiva.]]></source>
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<source><![CDATA[Propuesta de algoritmo de clasificación genético]]></source>
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